FPGA开发工程师简历模板
6 年 FPGA开发经验,主导过通信和图像处理领域多个重大项目,擅长高速接口设计和时序收敛。
关于 FPGA开发工程师简历模板
FPGA开发工程师简历模板由猫头鹰简历精心设计,覆盖个人信息、教育经历、工作经历、项目经历、技能专长与自我评价等完整板块,适合全行业等岗位求职者使用。模板采用 ATS 友好的语义化结构,兼容主流简历解析与打印系统,支持在线免费编辑、AI 智能润色、一键导出 PDF,5 分钟即可完成一份精美专业的求职简历,帮助你在校招、社招、跳槽、海外求职等场景中脱颖而出。
适用场景
适用于全行业等岗位的求职投递,无论是应届生秋招春招、社招跳槽、校招实习,还是海外英文简历制作、猎头定向投递、求职面试携带,均可直接套用。
撰写建议
开头用动词并量化成果;重点突出与目标岗位匹配的项目;技能关键词对齐 JD;控制 1-2 页;导出时保留默认字号以兼顾 ATS 解析与打印效果。
赖志鹏
求职意向
自我评价
6 年 FPGA开发经验,其中 2 年技术负责人经历。精通 Verilog/SystemVerilog,有通信、图像处理等多个领域项目经验。擅长高速接口设计 (PCIe/DDR)、DSP算法加速和时序收敛。具备扎实的数电模电基础,对性能和功耗平衡有深入理解。
工作经历
负责 5G基站芯片开发和系统验证。 • 主导 5G基带处理模块设计,基于 UltraScale+实现 PBCH/PDCCH处理,吞吐量达 10Gbps • 设计 DDR4内存控制器,通过多通道交织,带宽利用率提升至 95%+ • 优化 PCIe Gen3数据通路,实现 8GT/s稳定传输,误码率低于 10^-12 • 带领 5 人 FPGA团队完成年度目标,培养 2 名中级工程师,团队绩效 S
负责视频处理卡和智能分析设备开发。 • 完成 4 路 4K视频拼接模块,基于 SDI接口,延迟控制在 1 帧以内 • 实现深度学习加速器,通过定点化和流水线优化,推理速度提升 8 倍 • 设计图像增强算法,基于 FPGA并行处理,实时性优于 GPU方案 • 编写 FPGa开发规范和 IP 核复用文档,在部门内推广最佳实践
项目经验
5G AAU基带处理单元,需要满足高吞吐和低延迟要求
负责架构设计、模块划分、时序收敛和系统联调
5G基站规模商用,发货 10 万 + 套,获中国通信学会科技进步奖
智能视频分析盒子,支持人脸识别和行为分析
负责 CNN 加速引擎设计、存储优化和接口对接
产品成功打入安防市场,年销售额破亿
超高清视频拼接墙,支持 16 路 4K同步输出
负责视频同步、色彩校正和 EDID管理
技术指标行业领先,获公司技术创新一等奖
教育经历
研究方向:集成电路设计、嵌入式系统。GPA 3.6/4.0,发表 EI 论文 2 篇,获研究生学业奖学金。
技能
- Verilog/SystemVerilog
- Xilinx FPGA
- Intel FPGA
- PCIe协议
- DDR3/DDR4
- 时序约束
- Matlab/Simulink
- Python/Tcl
模板亮点
- ATS 友好格式,轻松通过初筛
- 专业视觉设计,第一眼出众
- 内容完全可自定义,AI 辅助写作
- 一键导出 PDF,随时投递
模板信息
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