关于 FPGA工程师 简历模板
FPGA工程师 简历模板由猫头鹰简历精心设计，覆盖个人信息、教育经历、工作经历、项目经历、技能专长与自我评价等完整板块，适合物理学、FPGA开发、硬件工程师等岗位求职者使用。模板采用 ATS 友好的语义化结构，兼容主流简历解析与打印系统，支持在线免费编辑、AI 智能润色、一键导出 PDF，5 分钟即可完成一份精美专业的求职简历，帮助你在校招、社招、跳槽、海外求职等场景中脱颖而出。
适用场景
适用于物理学、FPGA开发、硬件工程师、嵌入式软件等岗位的求职投递，无论是应届生秋招春招、社招跳槽、校招实习，还是海外英文简历制作、猎头定向投递、求职面试携带，均可直接套用。
撰写建议
项目描述用 STAR 法量化成果，技术栈按熟练度分层；有开源贡献或线上项目的附 GitHub/链接；关键词对齐 JD，篇幅控制在 1-2 页以内，方便 ATS 快速识别。
毛头鹰
FPGA工程师
手机 138****7703
邮箱 fpga.cd***@163.com
4年工作经验
出生日期 1996-01-29
男
求职意向
期望薪资
26K-40K
期望城市
成都
工作经历
成都某通信技术有限公司
FPGA工程师
2021.04-至今
实现软件无线电数字下变频链路，把滤波器系数定点化与溢出保护写成自检表。
用 ChipScope 与逻辑分析仪交叉验证 JESD204B 帧同步状态机迁移。
推动时钟树重构后重新锁 IO 延迟与 skew 报告归档。
现场排障一次 PCIe DMA 吞吐抖动，根因在 reference clock 旁路电容批次。
深圳某测量仪器有限公司
FPGA 开发助理
2020.03-2021.03
维护数据采集卡固件 FIFO 深度参数，整理约束文件版本。
协助焊接改版后与 SI 仿真对比眼图。
成都某大学联合实验室
毕设驻场
2019.09-2020.01
完成简易 DDS 波形发生器 Verilog 验证与板上测温。
项目经验
多相滤波器定点溢出专项
模块 owner
2023.05-2023.10
宽温试验偶发毛刺，怀疑中间和位宽不足。
职责
对每级和做统计分析并对比仿真位真模型。
加饱和与截断策略两支 A B 比特流。
与算法同事对齐动态范围需求文档版本。
成果
恶劣温循未再复现，资源上涨控制在可接受范围。
JESD 同步失锁场测复盘
现场支持
2024.01-2024.04
客户机房升级后链路间歇失锁，需区分板级与机房接地。
职责
抓取 ILA 长线日志与示波器 SYSREF 抖动同屏。
尝试禁用非必要扩频时钟。
输出临时与长期整改两张物料建议。
成果
临时接地与线缆整改后稳定运行三十天，客户签收阶段性报告。
PCIe DMA 吞吐抖动根因
联调主力
2022.08-2022.11
批次电容更换后 DMA 曲线锯齿化。
职责
对比纹波频谱与 reference 相位噪声。
与采购核对 MLCC 材质与谐振点。
回迁旧批次验证假设。
成果
根因书面化记入物料认证库，后续来料加一项抽检。
教育经历
成都某大学
物理学
·
本科
2015.09-2019.06
电动力学、固体物理、微机原理与接口技术、信号与系统；电子设计竞赛省二等奖；毕设高速 ADC 与 FPGA 接口时序分析。
技能
- Verilog 与 SystemVerilog 仿真（熟练）
- Xilinx Vivado 时序与约束（熟练）
- CDC 设计与代码评审清单（熟练）
- DSP 与 CIC 及 FIR 定点化（掌握）
- JESD204B 或 SERDES 基础（掌握）
- 嵌入式 C 驱动与寄存器表（掌握）
- 信号完整性与电源噪声入门（了解）
证书奖项
Xilinx FPGA 设计与优化认证培训结业
2022-07
时序与功耗专题。
全国计算机等级考试四级网络工程师
2018-03
网络协议基础。
大学英语六级
2018-06
阅读英文用户指南与时序例外章节。
模板亮点
- ATS 友好格式，轻松通过初筛
- 专业视觉设计，第一眼出众
- 内容完全可自定义，AI 辅助写作
- 一键导出 PDF，随时投递
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