职责
重排突发长度与仲裁策略。
与硬件确认数据线等长余量。
用 ILA 对齐仿真与板上波形。
关于 FPGA开发工程师 简历模板
FPGA开发工程师 简历模板由猫头鹰简历精心设计，覆盖个人信息、教育经历、工作经历、项目经历、技能专长与自我评价等完整板块，适合FPGA开发、硬件工程师、电子工程师等岗位求职者使用。模板采用 ATS 友好的语义化结构，兼容主流简历解析与打印系统，支持在线免费编辑、AI 智能润色、一键导出 PDF，5 分钟即可完成一份精美专业的求职简历，帮助你在校招、社招、跳槽、海外求职等场景中脱颖而出。
适用场景
适用于FPGA开发、硬件工程师、电子工程师等岗位的求职投递，无论是应届生秋招春招、社招跳槽、校招实习，还是海外英文简历制作、猎头定向投递、求职面试携带，均可直接套用。
撰写建议
项目描述用 STAR 法量化成果，技术栈按熟练度分层；有开源贡献或线上项目的附 GitHub/链接；关键词对齐 JD，篇幅控制在 1-2 页以内，方便 ATS 快速识别。
毛头鹰
手机
135****7788
邮箱
fp***@example.com
工作年限
6年
出生日期
1990-04-15
性别
男
求职意向
期望职位：
FPGA开发工程师
期望薪资：
30K-45K
所在城市：
成都
自我评价
六年 Xilinx 系图像链路 FPGA 经验，对跨时钟域约束与 CDC 检查有固定流程。集成阶段更关注仿真用例与板上抓包对齐，而不是只靠综合报告判断风险。与算法同事对齐定点位宽，减少溢出返工。
工作经历
成都某视觉技术有限公司
FPGA开发工程师
2019.08-至今
部门：FPGA组
实现 CameraLink 输入与 DDR3 帧缓存控制，完成带宽与时序收敛。 编写跨时钟域同步与约束文件，降低亚稳风险。 与软件同事对齐寄存器映射与中断节拍。 支持量产 FPGA 版本管理与回滚流程。
西安某电子研究所下属公司
逻辑工程师
2017.03-2019.07
部门：逻辑部
参与雷达信号预处理模块仿真与上板验证。 整理测试向量与版本记录。
项目经验
DDR3 帧缓存带宽优化
主设
2023.02-2023.09
高帧率场景下带宽不足丢帧。
成果
丢帧率下降，客户演示稳定性提升。
丢帧率下降，客户演示稳定性提升。
CDC 亚稳风险治理
评审负责人
2022.05-2022.10
偶发花屏难以复现。
职责
补全同步器级数与约束说明。 增加仿真随机延迟用例。 发布 CDC 检查清单。
补全同步器级数与约束说明。 增加仿真随机延迟用例。 发布 CDC 检查清单。
成果
花屏相关客诉下降，版本回归时间缩短。
花屏相关客诉下降，版本回归时间缩短。
寄存器映射对齐
接口人
2021.03-2021.06
驱动与逻辑字段理解不一致。
职责
统一寄存器表版本与变更记录。 增加只读自检寄存器。 组织联调周会。
统一寄存器表版本与变更记录。 增加只读自检寄存器。 组织联调周会。
成果
联调返工轮次减少，文档争议下降。
联调返工轮次减少，文档争议下降。
教育经历
电子科技大学
电子科学与技术
·
硕士
2014.09-2017.06
FPGA 与高速电路方向，三年制硕士。
技能
- Verilog 与时序约束（熟练）
- Vivado 综合实现与调试（熟练）
- DDR3 MIG 与带宽评估（掌握）
- 跨时钟域 CDC 设计（掌握）
- ChipScope ILA 在线调试（掌握）
- Modelsim 仿真用例编写（掌握）
- Python 离线数据对比脚本（了解）
证书
Xilinx FPGA 设计与优化认证
2019-12
工具链能力。
高速数字电路设计内训
2021-04
信号完整性基础。
英语 CET-6
2015-06
资料阅读。
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