数字前端设计工程师简历示例

6 年数字 IC设计经验，主导过多个 SoC芯片前端设计，精通 Verilog和 UVM验证方法学。

陆志远

手机 137****9012
邮箱 luzy@example.com
工作年限 6年
出生日期 1996-04-15
性别 男

求职意向

期望职位： 数字前端设计工程师
期望薪资： 35K-50K
所在城市： 上海

自我评价

6 年数字 IC设计经验，其中 2 年技术负责人经历。精通 SoC架构、RTL设计和逻辑综合，有 AI芯片和通信芯片经验。熟悉 Verilog、SystemVerilog和 UVM验证。具备扎实的计算机体系结构基础，对低功耗设计有深入理解。

工作经历

某半导体公司 高级数字 IC设计师/项目负责人
2021.06-至今
部门：IC设计部

负责 AI芯片前端设计和验证。 • 主导 NPU芯片设计，算力达 8TOPS，功耗仅 2W，性能业界领先 • 完成 PCIe控制器集成，支持 Gen3x8,吞吐量 64Gbps • 优化时钟和复位架构，PPA指标优于目标 20% • 带领 6 人团队完成流片，良率 95%,累计出货 100 万颗

某集成电路公司 数字 IC设计工程师
2018.07-2021.05
部门：研发部

负责通信芯片 RTL设计。 • 完成 5G基带模块设计，支持 Sub-6GHz频段 • 实现 DDR4 PHY接口，速率 3200Mbps • 参与 FPGA原型验证，加速系统调试 • 编写设计文档和验证报告，积累 IP核 5 个

项目经验

AI NPU芯片 数字前端负责人
2022.08-2023.09

AI边缘计算芯片，需要高算力和低功耗

职责
负责架构定义、RTL设计、综合和形式验证
成果
芯片成功量产，性能对标国际大厂，获国产替代奖
5G基带芯片 核心设计
2021.10-2022.06

5G通信基带芯片，需要支持多模多频

职责
负责信道编解码、MIMO处理、接口设计
成果
通过 5G认证，进入主流供应链
IoT SoC FPGA验证 FPGA工程师
2020.06-2021.03

物联网 SoC芯片，需要快速原型验证

职责
负责综合布局布线、板级调试、性能优化
成果
FPGA验证通过，为流片奠定基础

教育背景

复旦大学 微电子学与固体电子学 · 硕士
2015.09-2018.06

研究方向：数字 IC设计、SoC架构。GPA 3.7/4.0，发表 ICCD论文 1 篇，获研究生学业奖学金。

技能

  • Verilog
  • SystemVerilog
  • UVM
  • DC综合
  • FPGA
  • SoC架构
  • 低功耗设计
  • 脚本语言

模板亮点

  • ATS 友好格式，轻松通过初筛
  • 专业视觉设计，第一眼出众
  • 内容完全可自定义，AI 辅助写作
  • 一键导出 PDF，随时投递
  • 生成分享链接，方便线上投递

模板信息

适用地区中国大陆
简历分类design
导出格式PDF / 链接
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